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基于Verilog的逻辑分析仪触发电路的设计
基于Verilog的逻辑分析仪触发电路的设计
作者:
李姿景
李海霞
王二萍
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
逻辑分析仪
触发电路
Verilog
仿真
摘要:
分析了逻辑分析仪的工作原理和基本结构,并在此基础上讨论了逻辑分析仪的核心部分一触发电路模块的工作过程和用FPGA(Field Programmable Gate Array即现场可编程门阵列)实现的设计方法.同时给出了触发电路大部分模块的Verilog程序设计及仿真结果.
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文献信息
篇名
基于Verilog的逻辑分析仪触发电路的设计
来源期刊
北京电力高等专科学校学报(自然科学版)
学科
工学
关键词
逻辑分析仪
触发电路
Verilog
仿真
年,卷(期)
2010,(6)
所属期刊栏目
研究方向
页码范围
45-46
页数
2页
分类号
TN79
字数
语种
中文
DOI
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
李姿景
黄河科技学院信息工程学院
13
26
2.0
5.0
2
王二萍
黄河科技学院信息工程学院
17
42
4.0
6.0
3
李海霞
黄河科技学院信息工程学院
23
81
5.0
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研究主题发展历程
节点文献
逻辑分析仪
触发电路
Verilog
仿真
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
北京电力高等专科学校学报(自然科学版)
主办单位:
北京电力高等专科学校
出版周期:
月刊
ISSN:
1009-0118
CN:
11-4081/N
开本:
出版地:
北京市海淀区上园村
邮发代号:
创刊时间:
语种:
chi
出版文献量(篇)
6600
总下载数(次)
30
总被引数(次)
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