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摘要:
浮点运算单元FPU( Floating-point Unit)在当前CPU的运算中地位越来越重要,论文中实现了一种基于FPGA的快速单精度浮点运算器.该运算器采用了流水线和并行计算技术,使得浮点教运算的速度有了显著的提高.在QUARTUSII 7.1系统上对运算器已仿真成功,结果表明它可以运行在40.5MHz时钟工作频率下,能快速准确地完成各种加、减、乘和除算术运算.
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文献信息
篇名 快速单精度浮点运算器的设计与实现
来源期刊 河北工业大学学报 学科 工学
关键词 FPGA(现场可编程逻辑门阵列) 单精度 并行处理 并行加法器 阵列乘法器 阵列除法器
年,卷(期) 2011,(3) 所属期刊栏目
研究方向 页码范围 74-78
页数 分类号 TP323
字数 2094字 语种 中文
DOI 10.3969/j.issn.1007-2373.2011.03.016
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 赵红东 河北工业大学信息工程学院 88 427 10.0 17.0
2 田红丽 河北工业大学计算机科学与软件学院 16 29 3.0 4.0
6 闫会强 河北工业大学计算机科学与软件学院 16 53 4.0 6.0
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研究主题发展历程
节点文献
FPGA(现场可编程逻辑门阵列)
单精度
并行处理
并行加法器
阵列乘法器
阵列除法器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
河北工业大学学报
双月刊
1007-2373
13-1208/T
大16开
天津市北辰区双口镇西平道5340号
1917
chi
出版文献量(篇)
3202
总下载数(次)
10
总被引数(次)
21785
相关基金
河北省自然科学基金
英文译名:
官方网址:
项目类型:
学科类型:
论文1v1指导