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在RTL级革新系统级单芯片设计方法
在RTL级革新系统级单芯片设计方法
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摘要：
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基于RTL级硬件木马的检测方法
硬件木马
AES基准木马
RTL级
Verilog
perl
Viterbi解码器RTL级设计优化
卷积码
Viterbi解码器
寄存器传输级
数字通信系统
基于SystemC的系统级芯片设计方法研究
SOC
SystemC
RS编码器
Verilog HDL
系统级芯片设计语言和验证语言的发展
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中国集成电路
主办单位：
中国半导体行业协会
出版周期：
月刊
ISSN：
1681-5289
CN：
11-5209/TN
开本：
大16开
出版地：
北京朝阳区将台西路18号5号楼816室
邮发代号：
创刊时间：
1994
语种：
chi
出版文献量（篇）
4772
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6
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7210
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