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利用VHDL设计电路的简化问题
利用VHDL设计电路的简化问题
作者:
杨庆
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
VHDL
设计
电路
简化
摘要:
利用VHDL设计电路是目前对于较复杂的电路系统进行设计时的最好选择,但设计中如何进行电路的简化直接关系到电路的复杂度及可靠性.本文分析了VHDL设计中容易引起电路复杂化的原因,提出了相应的解决方法.
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文献信息
篇名
利用VHDL设计电路的简化问题
来源期刊
武汉科技学院学报
学科
工学
关键词
VHDL
设计
电路
简化
年,卷(期)
2006,(1)
所属期刊栏目
理论与应用研究
研究方向
页码范围
66-69
页数
4页
分类号
TN4|TN7
字数
2200字
语种
中文
DOI
10.3969/j.issn.1009-5160.2006.01.018
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
杨庆
湖北民族学院电气工程系
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7.0
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设计
电路
简化
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
武汉纺织大学学报
主办单位:
武汉纺织大学
出版周期:
双月刊
ISSN:
2095-414X
CN:
42-1818/Z
开本:
大16开
出版地:
武汉市武昌鲁巷纺织路1号
邮发代号:
创刊时间:
1988
语种:
chi
出版文献量(篇)
4063
总下载数(次)
13
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