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摘要:
深亚微米下芯片的物理设计面临很多挑战,特别是对于超大规模电路,在后端设计流程上要有新的方法.本文以应用于数字滤波的脉冲压缩芯片的物理设计为例,采用"模拟 IP "和改进的数模混合芯片设计流程,实现了模拟和数字部分的联合设计,保证了时序驱动下的持续收敛,并且详细介绍了布局规划、时钟树综合、时序优化及可靠性设计等关键步骤,可为其他类似的设计提供参考.
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文献信息
篇名 深亚微米下脉冲压缩芯片的物理设计实例
来源期刊 电子器件 学科 工学
关键词 深亚微米 物理设计 数模混合集成电路 布局布线 脉冲压缩
年,卷(期) 2008,(5) 所属期刊栏目 其他电子技术
研究方向 页码范围 1631-1634
页数 4页 分类号 TN713.7
字数 4156字 语种 中文
DOI 10.3969/j.issn.1005-9490.2008.05.057
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 徐睿 中国电子科技集团公司第五十八研究所 18 61 5.0 7.0
2 邹文英 中国电子科技集团公司第五十八研究所 4 14 2.0 3.0
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研究主题发展历程
节点文献
深亚微米
物理设计
数模混合集成电路
布局布线
脉冲压缩
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子器件
双月刊
1005-9490
32-1416/TN
大16开
南京市四牌楼2号
1978
chi
出版文献量(篇)
5460
总下载数(次)
21
总被引数(次)
27643
论文1v1指导