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基于阵列除法的数据接收/显示模块设计
基于阵列除法的数据接收/显示模块设计
作者:
刘建新
林华
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
雷达
BIN码
BCD码
Verilog HDL语言
现场可编程门阵列
摘要:
主要介绍基于FPGA的脉冲雷达高度表串行高度数据接收/显示模块的设计.在系统讨论异步串行高度数据接收/显示模块的内部结构的基础上,提出了以不恢复余数除法为基础的BIN码到BCD码的转换算法,并构造了以移位、加/减法为基础的阵列除法器.该算法速度快,逻辑简单,非常适合实时性要求较强的场合.最后通过仿真波形验证其内部时序的正确性.
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脉冲雷达高度表串行高度数据接收模块设计
雷达
串行高度数据
通用异步收发器(UART)
Verilog HDL
FPGA
高性能浮点除法和开方的设计与实现
SRT算法
选择函数
可变位宽
浮点除法/开方
迭代实现
阵列实现
流水实现
资源消耗
内容分析
文献信息
引文网络
相关学者/机构
相关基金
期刊文献
内容分析
关键词云
关键词热度
相关文献总数
(/次)
(/年)
文献信息
篇名
基于阵列除法的数据接收/显示模块设计
来源期刊
信息与电子工程
学科
工学
关键词
雷达
BIN码
BCD码
Verilog HDL语言
现场可编程门阵列
年,卷(期)
2009,(4)
所属期刊栏目
信号与信息处理
研究方向
页码范围
304-307
页数
4页
分类号
TN957.52
字数
2099字
语种
中文
DOI
10.3969/j.issn.1672-2892.2009.04.013
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
林华
中国工程物理研究院电子工程研究所
9
75
4.0
8.0
2
刘建新
中国工程物理研究院电子工程研究所
15
120
6.0
10.0
传播情况
被引次数趋势
(/次)
(/年)
引文网络
引文网络
二级参考文献
(6)
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参考文献(0)
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参考文献(1)
二级参考文献(0)
2003(1)
参考文献(1)
二级参考文献(0)
2009(0)
参考文献(0)
二级参考文献(0)
引证文献(0)
二级引证文献(0)
研究主题发展历程
节点文献
雷达
BIN码
BCD码
Verilog HDL语言
现场可编程门阵列
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
太赫兹科学与电子信息学报
主办单位:
中国工程物理研究院电子工程研究所
出版周期:
双月刊
ISSN:
2095-4980
CN:
51-1746/TN
开本:
大16开
出版地:
四川绵阳919信箱532分箱
邮发代号:
62-241
创刊时间:
2003
语种:
chi
出版文献量(篇)
3051
总下载数(次)
7
总被引数(次)
11167
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