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摘要:
为了不增加器件成本,方便和低压器件集成到一起时实现自主隔离,因而迫切需要解决既能兼容普通半导体材料工艺又能达到相应技术性能要求的器件设计.为此设计了一种采用NWELL而非N-外延层作为nLDMOS的漂移区,在漏源极两端都加上了场极板的nLDMOS结构.而漂移区的结构及场极板设计是控制源漏击穿电压的关键.我们利用半导体工艺模拟软件Athena和Atlas着重对NWELL漂移区的长度、注入剂量、结深与器件的耐压关系以及场极板的长度与器件的耐压关系进行了模拟仿真.最后利用迭代法对这些参数进行了优化,得到了700V nLDMOS击穿电压的次优解.通过在CMOS工艺线上流片验证,得出此器件的耐压能达700V,与模拟仿真一致.
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文献信息
篇名 700V nLDMOS击穿电压参数设计
来源期刊 电子与封装 学科 工学
关键词 nlDMOS 漂移区 场极板 击穿电压
年,卷(期) 2011,(7) 所属期刊栏目
研究方向 页码范围 35-38,43
页数 分类号 TN406
字数 956字 语种 中文
DOI 10.3969/j.issn.1681-1070.2011.07.008
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 文燕 3 3 1.0 1.0
2 张枫 1 1 1.0 1.0
3 李天贺 1 1 1.0 1.0
4 李娜 1 1 1.0 1.0
传播情况
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2001(1)
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2011(0)
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2015(1)
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  • 二级引证文献(0)
研究主题发展历程
节点文献
nlDMOS
漂移区
场极板
击穿电压
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子与封装
月刊
1681-1070
32-1709/TN
大16开
江苏无锡市惠河路5号(208信箱)
2002
chi
出版文献量(篇)
3006
总下载数(次)
24
总被引数(次)
9543
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