一种高速ZBT SRAM控制器设计

• 作者: 姚志文
• 来源期刊: 计算机技术与发展
• 学科: 工学
• 关键词: ZBT SRAM 同步设计 时序约束
• 年，卷（期）: 2012,（10）
• 页码范围: 202-204
• 分类号: TP39
• 字数: 2478字
• 语种: 中文

摘要

FPGA已经在雷达领域得到了广泛应用,然而其内部存储容量通常无法达到系统需求,因此必须为FPGA配置外部高速存储器.本设计采用两片高性能ZBT SRAM作为乒乓缓冲区交替工作,最高访问速率可达133MHz,使FPGA片外总存储容量达到32Mbit,满足设计要求.由于ZBT SRAM具有特殊的访问时序,必须使用FPGA的内部数字时钟管理模块DCM对时钟的相位进行精确控制,同时还要使用时序约束高级设计技术调整控制器的输入输出延时特性,使该控制器能够顺利地在FPGA内部信号处理系统和ZBT芯片之间完成高速数据交换.经过上述优化设计,采用VHDL代码编写可综合代码完成布线,目前该控制器已经成功地在某雷达导引头信号处理机中获得应用,验证了其有效性.

作者信息

序号	姓名	单位	发文数	被引次数	H指数	G指数
1	姚志文		4	6	1.0	2.0