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RS码并行编码器的设计实现
RS码并行编码器的设计实现
基本信息来源于合作网站，原文需代理用户跳转至来源网站获取
摘要：
RS码是一类具有很强纠错能力的多进制BCH码,也是一类典型的代数几何码.文中分析了GF(2)8域上的RS(255,223)码编码器的基本原理,并在Xilinx Xc6vsx315t FPGA上设计实现了RS(255,223)高速并行编码器.
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RS码编码器
并行乘法器
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研究主题发展历程
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RS码
编码器
高速并行
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相关学者/机构
期刊影响力
信息技术
主办单位：
黑龙江省信息技术学会
中国电子信息产业发展研究院
中国信息产业部电子信息中心
出版周期：
月刊
ISSN：
1009-2552
CN：
23-1557/TN
开本：
大16开
出版地：
哈尔滨市南岗区黄河路122号
邮发代号：
14-36
创刊时间：
1977
语种：
chi
出版文献量（篇）
11355
总下载数（次）
31
总被引数（次）
47901
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