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AES加密算法的FPGA优化设计
AES加密算法的FPGA优化设计
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摘要：
高级加密标准AES(Advanced Encryption Standard)算法由于其安全性高的优势而应用广泛,再结合FPGA的优势可实现加密速度快,开发周期短且可通用性强的AES加密算法.多轮加密的每一轮采用复用的方式以节省资源,且通过状态机控制加密过程.最后结合FPGA综合仿真,资源消耗为9643,最高工作频率为126.34MHz.
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电子世界
主办单位：
中国电子学会
出版周期：
半月刊
ISSN：
1003-0522
CN：
11-2086/TN
开本：
大16开
出版地：
北京市
邮发代号：
2-892
创刊时间：
1979
语种：
chi
出版文献量（篇）
36164
总下载数（次）
96
总被引数（次）
46655
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