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基于CMOS工艺的AES高速接口电路设计
基于CMOS工艺的AES高速接口电路设计
作者:
孙玲
施佺
陈海进
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
先进加密标准
串并转换
版图
CMOS互补逻辑
摘要:
为提高AES加密电路的数据吞吐量,采用0.6 μm CMOS工艺设计了输入接口单元电路.该接口电路接收串行的高速数据流,经过串并转换后,输出128路低速并行数据流.CMOS互补逻辑结构降低了电路的功耗.手工版图布局优化了芯片面积,降低了研究成本.
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文献信息
篇名
基于CMOS工艺的AES高速接口电路设计
来源期刊
电子器件
学科
工学
关键词
先进加密标准
串并转换
版图
CMOS互补逻辑
年,卷(期)
2004,(3)
所属期刊栏目
研究方向
页码范围
413-415,396
页数
4页
分类号
TM855
字数
1403字
语种
中文
DOI
10.3969/j.issn.1005-9490.2004.03.009
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
施佺
南通大学江苏省专用集成电路设计重点实验室
89
405
10.0
15.0
2
陈海进
南通大学江苏省专用集成电路设计重点实验室
21
104
5.0
9.0
3
孙玲
南通大学江苏省专用集成电路设计重点实验室
68
237
8.0
11.0
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2013(1)
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二级引证文献(1)
研究主题发展历程
节点文献
先进加密标准
串并转换
版图
CMOS互补逻辑
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子器件
主办单位:
东南大学
出版周期:
双月刊
ISSN:
1005-9490
CN:
32-1416/TN
开本:
大16开
出版地:
南京市四牌楼2号
邮发代号:
创刊时间:
1978
语种:
chi
出版文献量(篇)
5460
总下载数(次)
21
总被引数(次)
27643
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