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摘要:
采用一种新颖的异步FIFO设计方案,解决FPGA多时钟系统中不同时钟域传输数据的问题.该FIFO实现方案比传统方式简单,工作速度频率高,如设计采用了Verilog HDL硬件语言描述还具有良好的移植性.
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文献信息
篇名 高速异步FIFO的实现
来源期刊 西华大学学报(自然科学版) 学科 工学
关键词 FIFO 异步电路 多时钟系统 亚稳态
年,卷(期) 2005,(4) 所属期刊栏目 电气信息工程
研究方向 页码范围 77-79
页数 3页 分类号 TN911
字数 1393字 语种 中文
DOI 10.3969/j.issn.1673-159X.2005.04.025
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作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 阳小明 西华大学电气信息学院 24 39 3.0 5.0
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研究主题发展历程
节点文献
FIFO
异步电路
多时钟系统
亚稳态
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
西华大学学报(自然科学版)
双月刊
1673-159X
51-1686/N
大16开
四川省成都市金牛区
1982
chi
出版文献量(篇)
3399
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6
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16135
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