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摘要:
根据CMMB中LDPC码校验矩阵的结构特点,提出了一种部分并行译码结构的实现方法,并在XILINX的VirtexIV的XC4VLX80型FPGA上实现了这种结构。该设计充分利用了LDPC校验矩阵的规律,采用了一种适当的硬件结构和独特的存储器调用控制策略,故可在保证高性能和较大吞吐率的情况下,以较少的硬件资源实现两种码率的复用。
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IEEE
802.16e
LDPC译码器
部分并行
FPGA
基于FPGA的(3,6)LDPC码并行译码器设计与实现
LDPC码
校验矩阵
最小和算法
FPGA
一种高效的多码率LDPC译码器的设计
LDPC
CMMB
最小和算法
FPGA
内容分析
关键词云
关键词热度
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文献信息
篇名 基于CMMB系统的LDPC译码器的设计与实现
来源期刊 电子元器件应用 学科 工学
关键词 CMMB 中国移动多媒体广播 LDPC码 部分并行结构 译码器
年,卷(期) dzyqjyy_2010,(10) 所属期刊栏目
研究方向 页码范围 69-72
页数 4页 分类号 TN911.22
字数 语种
DOI
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作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 于忠臣 38 77 4.0 8.0
2 李江林 2 0 0.0 0.0
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2010(0)
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研究主题发展历程
节点文献
CMMB
中国移动多媒体广播
LDPC码
部分并行结构
译码器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子元器件应用
月刊
1563-4795
大16开
西安市科技路37号海星城市广场B座240
1999
chi
出版文献量(篇)
5842
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7
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