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摘要:
基于JESD204B接口协议设计和实现了一种新型8B10B编码器.利用极性信息简化编码码表;利用3B4B与5B6B并行编码提升电路工作频率;利用人为加入一位均衡信息,减少逻辑处理层数.仿真结果表明,电路单元面积1 756 μm2、功耗1.13 mW及最大工作频率342 mHz,相较于传统方法具有一定的改进且完全符合JESD204B协议规范.可应用于基于JESD204B接口协议的高速串行接口的设计中.
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文献信息
篇名 JESD204B接口协议中的8B10B编码器设计
来源期刊 电子器件 学科 工学
关键词 JESD204B Serdes接口 8B10B编码器 并行编码 查找表
年,卷(期) 2015,(5) 所属期刊栏目 固态电子器件及材料
研究方向 页码范围 1017-1021
页数 5页 分类号 TN919.3
字数 2720字 语种 中文
DOI 10.3969/j.issn.1005-9490.2015.05.011
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 姚亚峰 中国地质大学机械与电子信息学院 17 84 6.0 8.0
2 霍兴华 中国地质大学机械与电子信息学院 6 32 3.0 5.0
3 贾茜茜 中国地质大学机械与电子信息学院 1 16 1.0 1.0
4 刘建 中国地质大学机械与电子信息学院 4 30 3.0 4.0
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节点文献
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Serdes接口
8B10B编码器
并行编码
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电子器件
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