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摘要:
本文提供了一种准确高效的多角多模的快速时序收敛ECO解决方案,可以支持复杂SoC集成电路层次化设计和多电压域设计.在时序优化过程中不但考虑了物理布局因素约束,还综合考虑了物理布线带来的影响,可以满足20nm先进工艺条件下的设计规则.不但保证了时延计算精度,而且与物理实现PR工具和静态时序分析STA工具保持着很好的一致性.它具有先进的优化算法,灵活的流程控制,能快速实现Setup,Hold,Max-transition等多目标的时序收敛,保证了芯片按时投片生产和产品上市时间.
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文献信息
篇名 考虑物理布局布线约束的快速时序收敛
来源期刊 中国集成电路 学科
关键词 时序收敛 多角多模 时序优化
年,卷(期) 2016,(1) 所属期刊栏目 设计
研究方向 页码范围 44-47,59
页数 5页 分类号
字数 3136字 语种 中文
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作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 刘毅 3 4 1.0 2.0
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研究主题发展历程
节点文献
时序收敛
多角多模
时序优化
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
中国集成电路
月刊
1681-5289
11-5209/TN
大16开
北京朝阳区将台西路18号5号楼816室
1994
chi
出版文献量(篇)
4772
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6
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