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【期刊】
基于V93k的多时钟域集成电路测试技术研究
作者:
周圣泽
唐锐
罗宏伟
陈勇帆
刊名:
电子产品可靠性与环境试验
发表时间:
2019-05-01
摘要:
随着复杂集成电路的飞速发展,SoC产品成为了整机系统的重要解决方案.由于此类产品的复杂结构、多时钟域特性,对测试方法和测试技术也提出了更高的要求.尽管测试仪器设备及测试手段在近年来也在快速发展,但是仍然不能完全满足此类产品发展的需求.如何快速、有效地完成此类产品的测试一直是测试从业人员特别关注的问题.针对此类多时钟域产品,共时测试方案是一种高效的解决方案,但是其实现过程较为复杂,其向量转换、测试程序开发等方面都需要借助特别的手段来实现.主要针对多时钟域产品共时测试开发的解决方案、向量转换等问题进行了研究,并给出了基于V93k ATE进行单时钟和多时钟测试等多种解决途径.
集成电路
多时钟域
共时测试
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2.
【期刊】
多时钟域数据传递的FPGA实现
作者:
鲁玲
刊名:
现代电子技术
发表时间:
2007-10-01
摘要:
分析了多时钟域数据传递设计中亚稳态的产生以及对整个电路性能和功能的影响,以一款异步并行通信接口芯片的设计为例,详细描述了采用同步器、FIFO实现8位并行数据到16位并行数据的两时钟域异步转换的过程.电路在XilinxISE6.0环境下用Modelsim5.7进行了逻辑仿真,结果表明系统稳定可靠.
多时钟域
亚稳态
FPGA
异步信号
FIFO
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3.
【期刊】
多时钟域的异步信号的参考解决
作者:
袁伟
赵勇
刊名:
现代电子技术
发表时间:
2006-05-01
摘要:
在ASIC设计中,不同的模块往往工作在不同的频率下,在一个芯片上采用单时钟设计基本上是不可能实现的.多时钟域的设计是SOC设计中的一个重要环节.分析了多时钟域设计中异步信号的产生以及带来的亚稳定性对整个电路性能和功能的影响,提出了采用同步器,握手通信协议,FIFO等方法减小亚稳定性概率和其影响的措施,并且给出了实用电路图并进行了实现,从而使得电路能够在多时钟域下更加健壮和稳定.
多时钟域
亚稳定性
异步信号
单时钟设计
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4.
【期刊】
ASIC中的异步FIFO的实现
作者:
岳洪伟
梁晓莹
刊名:
科技与创新
发表时间:
2007-02-01
摘要:
绝大部分ASIC设计工程师在实际工作中都会遇到多时钟域设计的问题,多时钟域设计的一个难题是如何避免亚稳态的产生.异步FIFO是一种不同时钟域之间传递数据的常用方法.避免亚稳态问题及空满控制信号的产生是异步FIFO设计的两个关键.本文针对异步时序产生的问题提出了一种新的异步FIFO设计方案.用这样一个异步FIFO模块实现FPGA内部不同时钟系统之间的数据接口,它们之间不需要互相握手,只需跟接口FIFO模块进行交互就可以了,使设计变得非常简单和容易.此异步FIFO基于Altera公司的Cyclone系列实现的,采用VHDL语言设计,通过对设计进行简单的修改,即可用于各种不同的系统的设计,经过充分测试和优化,该异步FIFO运行稳定,占用FPGA内部资源也非常少.
多时钟域
亚稳态
异步FIFO
VHDL语言
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5.
【期刊】
基于ATE的FPGA亚稳态的激发与验证
作者:
孙黎
张涛
王相阳
刊名:
计算机测量与控制
发表时间:
2014-11-01
摘要:
在FPGA电路设计中,信号间常发生跨时钟域的传输,亚稳态问题成为影响系统可靠性的关键因素;目前的测试方法不能满足对亚稳态的测试,如何有效地激发亚稳态及验证亚稳态保护措施的有效性,成为FPG-A测试的关键问题;文章详细分析了FPGA中亚稳态产生的根源,基于ATE测试系统,提出了一种有效的多时钟域的测试方法,通过设计输入信号间的时序偏差,激发亚稳态,并验证电路相应的保护措施是否有效;在此基础上,设计了基于ATE的测试系统,调整时钟间隔,成功的激发出亚稳态,并验证了经过两级同步后的电路有效地避免了亚稳态的传播.
自动测试设备
现场可编程门阵列
亚稳态
软件测试
多时钟域
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6.
【期刊】
多模式多时钟域芯片的物理设计方法
作者:
覃晓莹
郑湘南
王政集
粟涛
刊名:
中山大学学报(自然科学版)
发表时间:
2015-03-01
摘要:
为了降低测试成本和难度,提高质量和成品率,量产芯片一般包含存储器内建自测试(MBIST)模式和扫描链测试(Scan Chain Test)模式。另一方面,随着芯片集成的功能不断增多,设计时一般会采用多个不同时钟。针对这种情况,本文提出了一种通过改变时序约束,实现此类芯片多模式归一化的物理设计方法,称为混合模式(Mix-mode)。把该方法运用到一款基于130 nm 工艺的视频后处理专用芯片上,采用 Synopsys IC Com-piler (ICC)工具进行布局布线。结果表明,与采用 ICC 工具提供的多模式(Multi-Mode)设计方法相比,采用该方法完成的物理版图在工具运行时间、时序、功耗、面积、总线长等方面都有更好的结果。
多模式
多时钟域
跨时钟路径
物理设计
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7.
【期刊】
异步FIFO的设计与验证
作者:
彭莉
秦建业
付宇卓
刊名:
计算机工程与应用
发表时间:
2005-03-01
摘要:
多时钟域设计的一个难题是如何避免亚稳态的产生.异步FIFO是一种不同时钟域之间传递数据的常用方法.避免亚稳态问题及空满控制信号的产生是异步FIFO设计的两个难题.传统的异步FIFO设计采用同步读写地址后比较产生空满标志的方法,面积大、工作频率低.针对这些问题,文章提出了一种新的异步FIFO设计方案,它改进格雷编码电路,提高异步FIFO的工作频率,用先比较读写地址产生空满标志,再同步到相应时钟域的方法避免使用大量的同步寄存器,减小面积空间.EDA综合及FPGA验证的结果均表明,改进后异步FIFO的性能有了显著提高.
多时钟域
亚稳态
异步FIFO
格雷码
空满信号
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8.
【期刊】
SOPC设计中多时钟域间的数据传递
作者:
王春玲
刊名:
山东农业大学学报(自然科学版)
发表时间:
2008-04-01
摘要:
研究可编程系统芯片(SOPC)设计中常见的多时钟域间的数据传递.分析多时钟域间亚稳态的产生机理和危害,并讨论消除亚稳态的参数约束和多时钟域数据传递的不同形式.针对常用的同步化策略,提出六种数据可靠传递的方法,并简析其应用特点.
多时钟域
数据传递
亚稳态
同步化
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9.
【期刊】
多时钟域处理器架构的性能和功耗分析
作者:
朱晓冬
王世明
刊名:
计算机工程
发表时间:
2005-01-01
摘要:
研究一种新的多时钟域的处理器架构,它把处理器分成几个工作在不同时钟下的时钟域,每个域有自己独立的工作电压和时钟频率,可以大大缓解高速处理器设计中最棘手的全局时钟分布问题,并且每个域的工作电压和工作频率可以根据应用的实际需求动态地调整,可以平均节省约20%的功耗.此外分析了全局异步局部同步时钟方案的结构及电压和工作频率调整的算法,并给出用SimpleScalar和Wattch仿真工具得到的仿真结果.
处理器
多时钟域
低功耗
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10.
【期刊】
基于Gray码的异步FIFO接口技术及其应用
作者:
汪东
马剑武
陈书明
刊名:
计算机工程与科学
发表时间:
2005-01-01
摘要:
本文介绍了利用异步FIFO在跨时钟域的逻辑设计中进行异步接口的技术,介绍了利用Gray码作异步FIFO指针的方法.这些技术和方法对于异步逻辑的设计具有广泛的参考意义.
异步FIFO
多时钟域
异步逻辑
Gray码
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