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时钟数字平滑技术在FPGA中的设计
时钟数字平滑技术在FPGA中的设计
作者:
杨万全
杨晓莹
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
数字平滑
PLLs
DRAM
时钟切换
摘要:
时钟平滑技术是复分接系统中关键的接口技术,传统设计中锁相环部分使用FPGA外围芯片电路实现,占用硬件空间,成本高,又由于是模拟电路而调试复杂.该文提出了一种不使用任何外围电路而用FPGA内部逻辑实现对基群信号非均匀数据和时钟的平滑处理技术,并例举实例,论述设计中的参数设置和时钟切换技巧.
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内容分析
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关键词热度
相关文献总数
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(/年)
文献信息
篇名
时钟数字平滑技术在FPGA中的设计
来源期刊
实验科学与技术
学科
工学
关键词
数字平滑
PLLs
DRAM
时钟切换
年,卷(期)
2006,(2)
所属期刊栏目
实验技术
研究方向
页码范围
13-15
页数
3页
分类号
TN7
字数
2056字
语种
中文
DOI
10.3969/j.issn.1672-4550.2006.02.005
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
杨万全
32
248
9.0
15.0
2
杨晓莹
1
2
1.0
1.0
传播情况
被引次数趋势
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引文网络
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(0)
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(0)
节点文献
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2010(1)
引证文献(1)
二级引证文献(0)
2017(1)
引证文献(1)
二级引证文献(0)
研究主题发展历程
节点文献
数字平滑
PLLs
DRAM
时钟切换
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
实验科学与技术
主办单位:
四川省高教学会
电子科技大学
出版周期:
双月刊
ISSN:
1672-4550
CN:
51-1653/T
开本:
大16开
出版地:
四川省成都市建设北路二段4号
邮发代号:
62-287
创刊时间:
2003
语种:
chi
出版文献量(篇)
5811
总下载数(次)
11
总被引数(次)
26929
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