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摘要:
一种数模混合芯片通过在芯片设计过程中,增加了可测性设计,使得芯片建立故障的敏感化通路,观测到芯片对于激励的响应,从而判断电路是否存在故障。根据芯片各个模块的特性,采用不同的可测性方法对其进行具体设计,数字部分采用SCAN的测试方式进行可测性设计,内部的存储器采用MBIST的测试方法、并通过流片后使用测试台对芯片进行测试,对可测性设计进行了验证。
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一种针对多级串联模拟电路的可测性设计技术
可测性设计
边界扫描
模拟电路
测试
基于DES理论的数模混合电路可测试性研究
散模混合电路
离散事件系统
可测试性
最小测试集
故障覆盖率
内容分析
关键词云
关键词热度
相关文献总数  
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文献信息
篇名 一种数模混合芯片的可测性设计和实现
来源期刊 集成电路通讯 学科 工学
关键词 SOC 可测性设计 测试向量
年,卷(期) jcdltx_2016,(4) 所属期刊栏目
研究方向 页码范围 22-27
页数 6页 分类号 TN407
字数 语种
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 张瑾 7 30 2.0 5.0
2 余向阳 6 4 1.0 2.0
3 秦盼 1 0 0.0 0.0
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研究主题发展历程
节点文献
SOC
可测性设计
测试向量
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
集成电路通讯
季刊
大16开
安徽省蚌埠市06信箱
1983
chi
出版文献量(篇)
868
总下载数(次)
16
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