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摘要:
当前基于现场可编程门阵列(FPGA)的动态部分可重构设计已经成为实现硬件加速的最热门方法之一,但分区的方法直接影响可重构区域面积和重配置时间.因此,研究将可重构系统划分为许多可重构模块(RMs),并分配到FPGA上的可重构区域(RRs)的方法具有重要意义.在分析和评价现有分区技术的重构时间和区域面积利用率的基础上,提出了一种新的动态部分可重构方案.该方法基于图形聚类算法对分区过程进行优化,自动寻找最优分区方案,并在重配置过程中实现了可重构区域之间走线的动态连接,最终实现重构时间和区域面积的同时优化,与Vipin算法方案相比,该设计方案的重配置时间减少了约10%,可重构面积减少了约18.5%.
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文献信息
篇名 基于聚类分区算法的FPGA高效动态部分可重构设计
来源期刊 电子与封装 学科 工学
关键词 FPGA 动态部分可重构 分区算法
年,卷(期) 2018,(9) 所属期刊栏目 电路设计
研究方向 页码范围 8-14
页数 7页 分类号 TN402
字数 3616字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 胡凯 中国电子科技集团公司第五十八研究所 15 33 4.0 5.0
2 董宜平 中国电子科技集团公司第五十八研究所 9 12 2.0 3.0
3 谢达 中国电子科技集团公司第五十八研究所 8 9 2.0 3.0
4 宋林峰 中国电子科技集团公司第五十八研究所 2 3 1.0 1.0
传播情况
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引文网络
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2020(2)
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研究主题发展历程
节点文献
FPGA
动态部分可重构
分区算法
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子与封装
月刊
1681-1070
32-1709/TN
大16开
江苏无锡市惠河路5号(208信箱)
2002
chi
出版文献量(篇)
3006
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24
总被引数(次)
9543
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