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摘要:
该文介绍了5G标准中LDPC码的特点,比较分析了各种译码算法的性能,提出了译码器实现的总体架构:将译码器分为高速译码器和低信噪比译码器。高速译码器适用于码率高、吞吐率要求高的情形,为译码器的主体;低信噪比译码器主要针对低码率、低信噪比下的高性能译码,处理一些极限情形下的通信,对吞吐率要求不高。分别对高速译码器和低信噪比译码器进行了设计实践,给出了FPGA综合结果和吞吐率分析结果。
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IEEE
802.16e
LDPC译码器
部分并行
FPGA
基于FPGA的(3,6)LDPC码并行译码器设计与实现
LDPC码
校验矩阵
最小和算法
FPGA
内容分析
关键词云
关键词热度
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文献信息
篇名 5G LDPC码译码器实现
来源期刊 电子与信息学报 学科
关键词 5G移动通信 低密度奇偶校验码 译码器 FPGA
年,卷(期) 2021,(4) 所属期刊栏目
研究方向 页码范围 1112-1119
页数 8页 分类号 TN915
字数 语种 中文
DOI 10.11999/JEIT200046
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研究主题发展历程
节点文献
5G移动通信
低密度奇偶校验码
译码器
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子与信息学报
月刊
1009-5896
11-4494/TN
大16开
北京市北四环西路19号
2-179
1979
chi
出版文献量(篇)
9870
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11
总被引数(次)
95911
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