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摘要:
提出了一种适用于分数分频锁相环频率综合器的全数字噪声整型△∑调制器电路结构新的设计方法,并将其最终实现.采用了流水线技术和新的CST算法优化多位输入加法器结构,从而降低了整体的复杂度和功耗.这种电路结构通过了Matlab的行为级仿真,ASIC全定制实现并流片,该结构也通过VHDL综合实现验证,最后给出的测试结果表明该电路具有良好的性能,可应用于单片千兆赫兹级低功耗CMOS频率综合器中.
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内容分析
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文献信息
篇名 △∑调制器在分数分频频率综合器中的分析与设计
来源期刊 半导体学报 学科 工学
关键词 △∑调制器 分数分频频率综合器 噪声整型结构
年,卷(期) 2006,(1) 所属期刊栏目 研究快报
研究方向 页码范围 41-46
页数 6页 分类号 TN761
字数 1093字 语种 中文
DOI 10.3321/j.issn:0253-4177.2006.01.009
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 任俊彦 复旦大学微电子学系专用集成电路与系统国家重点实验室 116 450 11.0 14.0
2 郑增钰 复旦大学微电子学系专用集成电路与系统国家重点实验室 19 154 6.0 12.0
3 许俊 复旦大学微电子学系专用集成电路与系统国家重点实验室 26 168 9.0 11.0
4 张伟超 复旦大学微电子学系专用集成电路与系统国家重点实验室 1 4 1.0 1.0
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研究主题发展历程
节点文献
△∑调制器
分数分频频率综合器
噪声整型结构
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
半导体学报(英文版)
月刊
1674-4926
11-5781/TN
大16开
北京912信箱
2-184
1980
eng
出版文献量(篇)
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8
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