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摘要:
传统加法器在处理多操作数累加时,必须进行多次循环相加操作.针对该问题设计5操作数并行加法器及其高速进位接口.电路采用多操作数并行本位相加和底层进位级联传递的方式,在一定程度上实现多操作数间的并行操作,减少相加次数.模拟结果验证了该加法器的设计合理性,证明其能缩短累加时间、提高运算效率.
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内容分析
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文献信息
篇名 5加数并行加法器及其进位接口
来源期刊 计算机工程 学科 工学
关键词 加法器 超前进位加法器 进位接口
年,卷(期) 2010,(1) 所属期刊栏目 开发研究与设计技术
研究方向 页码范围 251-252,259
页数 3页 分类号 TP342.21
字数 2102字 语种 中文
DOI 10.3969/j.issn.1000-3428.2010.01.087
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 刘杰 阜阳师范学院物理与电子科学学院 58 176 7.0 10.0
2 易茂祥 台肥工业大学应用物理系 1 0 0.0 0.0
传播情况
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研究主题发展历程
节点文献
加法器
超前进位加法器
进位接口
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
31987
总下载数(次)
53
总被引数(次)
317027
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