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一种静态电路兼容的4GHz 64位动态加法器设计
一种静态电路兼容的4GHz 64位动态加法器设计
原文服务方：
微电子学与计算机
摘要：
设计了一个与静态电路兼容的64位动态加法器,采用嵌入逻辑的动态触发器,以及多相位时钟技术,实现了与上、下级静态电路的接口.在加法器内部采用稀疏先行进位策略平衡逻辑路径长度以降低内部负载,提高性能.在STMicro 90nm CMOS工艺下,该加法器可工作在4GHz时钟下,功耗45.9mW.
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动态电路
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期刊影响力
微电子学与计算机
主办单位：
中国航天科技集团公司第九研究院第七七一研究所
出版周期：
月刊
ISSN：
1000-7180
CN：
61-1123/TN
开本：
大16开
出版地：
邮发代号：
创刊时间：
1972-01-01
语种：
chi
出版文献量（篇）
9826
总下载数（次）
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59060
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